0001
0002
0003
0004
0005
0006
0007 #ifndef _DT_BINDINGS_AMLOGIC_MESON8B_CLKC_RESET_H
0008 #define _DT_BINDINGS_AMLOGIC_MESON8B_CLKC_RESET_H
0009
0010 #define CLKC_RESET_L2_CACHE_SOFT_RESET 0
0011 #define CLKC_RESET_AXI_64_TO_128_BRIDGE_A5_SOFT_RESET 1
0012 #define CLKC_RESET_SCU_SOFT_RESET 2
0013 #define CLKC_RESET_CPU0_SOFT_RESET 3
0014 #define CLKC_RESET_CPU1_SOFT_RESET 4
0015 #define CLKC_RESET_CPU2_SOFT_RESET 5
0016 #define CLKC_RESET_CPU3_SOFT_RESET 6
0017 #define CLKC_RESET_A5_GLOBAL_RESET 7
0018 #define CLKC_RESET_A5_AXI_SOFT_RESET 8
0019 #define CLKC_RESET_A5_ABP_SOFT_RESET 9
0020 #define CLKC_RESET_AXI_64_TO_128_BRIDGE_MMC_SOFT_RESET 10
0021 #define CLKC_RESET_VID_CLK_CNTL_SOFT_RESET 11
0022 #define CLKC_RESET_VID_DIVIDER_CNTL_SOFT_RESET_POST 12
0023 #define CLKC_RESET_VID_DIVIDER_CNTL_SOFT_RESET_PRE 13
0024 #define CLKC_RESET_VID_DIVIDER_CNTL_RESET_N_POST 14
0025 #define CLKC_RESET_VID_DIVIDER_CNTL_RESET_N_PRE 15
0026
0027 #endif