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OSCL-LXR

 
 

    


0001 /* SPDX-License-Identifier: GPL-2.0 */
0002 /*
0003  * Copyright (c) 2018, The Linux Foundation. All rights reserved.
0004  */
0005 
0006 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_QCS404_H
0007 #define _DT_BINDINGS_CLK_QCOM_GCC_QCS404_H
0008 
0009 #define GCC_APSS_AHB_CLK_SRC                0
0010 #define GCC_BLSP1_QUP0_I2C_APPS_CLK_SRC         1
0011 #define GCC_BLSP1_QUP0_SPI_APPS_CLK_SRC         2
0012 #define GCC_BLSP1_QUP1_I2C_APPS_CLK_SRC         3
0013 #define GCC_BLSP1_QUP1_SPI_APPS_CLK_SRC         4
0014 #define GCC_BLSP1_QUP2_I2C_APPS_CLK_SRC         5
0015 #define GCC_BLSP1_QUP2_SPI_APPS_CLK_SRC         6
0016 #define GCC_BLSP1_QUP3_I2C_APPS_CLK_SRC         7
0017 #define GCC_BLSP1_QUP3_SPI_APPS_CLK_SRC         8
0018 #define GCC_BLSP1_QUP4_I2C_APPS_CLK_SRC         9
0019 #define GCC_BLSP1_QUP4_SPI_APPS_CLK_SRC         10
0020 #define GCC_BLSP1_UART0_APPS_CLK_SRC            11
0021 #define GCC_BLSP1_UART1_APPS_CLK_SRC            12
0022 #define GCC_BLSP1_UART2_APPS_CLK_SRC            13
0023 #define GCC_BLSP1_UART3_APPS_CLK_SRC            14
0024 #define GCC_BLSP2_QUP0_I2C_APPS_CLK_SRC         15
0025 #define GCC_BLSP2_QUP0_SPI_APPS_CLK_SRC         16
0026 #define GCC_BLSP2_UART0_APPS_CLK_SRC            17
0027 #define GCC_BYTE0_CLK_SRC               18
0028 #define GCC_EMAC_CLK_SRC                19
0029 #define GCC_EMAC_PTP_CLK_SRC                20
0030 #define GCC_ESC0_CLK_SRC                21
0031 #define GCC_APSS_AHB_CLK                22
0032 #define GCC_APSS_AXI_CLK                23
0033 #define GCC_BIMC_APSS_AXI_CLK               24
0034 #define GCC_BIMC_GFX_CLK                25
0035 #define GCC_BIMC_MDSS_CLK               26
0036 #define GCC_BLSP1_AHB_CLK               27
0037 #define GCC_BLSP1_QUP0_I2C_APPS_CLK         28
0038 #define GCC_BLSP1_QUP0_SPI_APPS_CLK         29
0039 #define GCC_BLSP1_QUP1_I2C_APPS_CLK         30
0040 #define GCC_BLSP1_QUP1_SPI_APPS_CLK         31
0041 #define GCC_BLSP1_QUP2_I2C_APPS_CLK         32
0042 #define GCC_BLSP1_QUP2_SPI_APPS_CLK         33
0043 #define GCC_BLSP1_QUP3_I2C_APPS_CLK         34
0044 #define GCC_BLSP1_QUP3_SPI_APPS_CLK         35
0045 #define GCC_BLSP1_QUP4_I2C_APPS_CLK         36
0046 #define GCC_BLSP1_QUP4_SPI_APPS_CLK         37
0047 #define GCC_BLSP1_UART0_APPS_CLK            38
0048 #define GCC_BLSP1_UART1_APPS_CLK            39
0049 #define GCC_BLSP1_UART2_APPS_CLK            40
0050 #define GCC_BLSP1_UART3_APPS_CLK            41
0051 #define GCC_BLSP2_AHB_CLK               42
0052 #define GCC_BLSP2_QUP0_I2C_APPS_CLK         43
0053 #define GCC_BLSP2_QUP0_SPI_APPS_CLK         44
0054 #define GCC_BLSP2_UART0_APPS_CLK            45
0055 #define GCC_BOOT_ROM_AHB_CLK                46
0056 #define GCC_DCC_CLK                 47
0057 #define GCC_GENI_IR_H_CLK               48
0058 #define GCC_ETH_AXI_CLK                 49
0059 #define GCC_ETH_PTP_CLK                 50
0060 #define GCC_ETH_RGMII_CLK               51
0061 #define GCC_ETH_SLAVE_AHB_CLK               52
0062 #define GCC_GENI_IR_S_CLK               53
0063 #define GCC_GP1_CLK                 54
0064 #define GCC_GP2_CLK                 55
0065 #define GCC_GP3_CLK                 56
0066 #define GCC_MDSS_AHB_CLK                57
0067 #define GCC_MDSS_AXI_CLK                58
0068 #define GCC_MDSS_BYTE0_CLK              59
0069 #define GCC_MDSS_ESC0_CLK               60
0070 #define GCC_MDSS_HDMI_APP_CLK               61
0071 #define GCC_MDSS_HDMI_PCLK_CLK              62
0072 #define GCC_MDSS_MDP_CLK                63
0073 #define GCC_MDSS_PCLK0_CLK              64
0074 #define GCC_MDSS_VSYNC_CLK              65
0075 #define GCC_OXILI_AHB_CLK               66
0076 #define GCC_OXILI_GFX3D_CLK             67
0077 #define GCC_PCIE_0_AUX_CLK              68
0078 #define GCC_PCIE_0_CFG_AHB_CLK              69
0079 #define GCC_PCIE_0_MSTR_AXI_CLK             70
0080 #define GCC_PCIE_0_PIPE_CLK             71
0081 #define GCC_PCIE_0_SLV_AXI_CLK              72
0082 #define GCC_PCNOC_USB2_CLK              73
0083 #define GCC_PCNOC_USB3_CLK              74
0084 #define GCC_PDM2_CLK                    75
0085 #define GCC_PDM_AHB_CLK                 76
0086 #define GCC_VSYNC_CLK_SRC               77
0087 #define GCC_PRNG_AHB_CLK                78
0088 #define GCC_PWM0_XO512_CLK              79
0089 #define GCC_PWM1_XO512_CLK              80
0090 #define GCC_PWM2_XO512_CLK              81
0091 #define GCC_SDCC1_AHB_CLK               82
0092 #define GCC_SDCC1_APPS_CLK              83
0093 #define GCC_SDCC1_ICE_CORE_CLK              84
0094 #define GCC_SDCC2_AHB_CLK               85
0095 #define GCC_SDCC2_APPS_CLK              86
0096 #define GCC_SYS_NOC_USB3_CLK                87
0097 #define GCC_USB20_MOCK_UTMI_CLK             88
0098 #define GCC_USB2A_PHY_SLEEP_CLK             89
0099 #define GCC_USB30_MASTER_CLK                90
0100 #define GCC_USB30_MOCK_UTMI_CLK             91
0101 #define GCC_USB30_SLEEP_CLK             92
0102 #define GCC_USB3_PHY_AUX_CLK                93
0103 #define GCC_USB3_PHY_PIPE_CLK               94
0104 #define GCC_USB_HS_PHY_CFG_AHB_CLK          95
0105 #define GCC_USB_HS_SYSTEM_CLK               96
0106 #define GCC_GFX3D_CLK_SRC               97
0107 #define GCC_GP1_CLK_SRC                 98
0108 #define GCC_GP2_CLK_SRC                 99
0109 #define GCC_GP3_CLK_SRC                 100
0110 #define GCC_GPLL0_OUT_MAIN              101
0111 #define GCC_GPLL1_OUT_MAIN              102
0112 #define GCC_GPLL3_OUT_MAIN              103
0113 #define GCC_GPLL4_OUT_MAIN              104
0114 #define GCC_HDMI_APP_CLK_SRC                105
0115 #define GCC_HDMI_PCLK_CLK_SRC               106
0116 #define GCC_MDP_CLK_SRC                 107
0117 #define GCC_PCIE_0_AUX_CLK_SRC              108
0118 #define GCC_PCIE_0_PIPE_CLK_SRC             109
0119 #define GCC_PCLK0_CLK_SRC               110
0120 #define GCC_PDM2_CLK_SRC                111
0121 #define GCC_SDCC1_APPS_CLK_SRC              112
0122 #define GCC_SDCC1_ICE_CORE_CLK_SRC          113
0123 #define GCC_SDCC2_APPS_CLK_SRC              114
0124 #define GCC_USB20_MOCK_UTMI_CLK_SRC         115
0125 #define GCC_USB30_MASTER_CLK_SRC            116
0126 #define GCC_USB30_MOCK_UTMI_CLK_SRC         117
0127 #define GCC_USB3_PHY_AUX_CLK_SRC            118
0128 #define GCC_USB_HS_SYSTEM_CLK_SRC           119
0129 #define GCC_GPLL0_AO_CLK_SRC                120
0130 #define GCC_USB_HS_INACTIVITY_TIMERS_CLK        122
0131 #define GCC_GPLL0_AO_OUT_MAIN               123
0132 #define GCC_GPLL0_SLEEP_CLK_SRC             124
0133 #define GCC_GPLL6                   125
0134 #define GCC_GPLL6_OUT_AUX               126
0135 #define GCC_MDSS_MDP_VOTE_CLK               127
0136 #define GCC_MDSS_ROTATOR_VOTE_CLK           128
0137 #define GCC_BIMC_GPU_CLK                129
0138 #define GCC_GTCU_AHB_CLK                130
0139 #define GCC_GFX_TCU_CLK                 131
0140 #define GCC_GFX_TBU_CLK                 132
0141 #define GCC_SMMU_CFG_CLK                133
0142 #define GCC_APSS_TCU_CLK                134
0143 #define GCC_CRYPTO_AHB_CLK              135
0144 #define GCC_CRYPTO_AXI_CLK              136
0145 #define GCC_CRYPTO_CLK                  137
0146 #define GCC_MDP_TBU_CLK                 138
0147 #define GCC_QDSS_DAP_CLK                139
0148 #define GCC_DCC_XO_CLK                  140
0149 #define GCC_WCSS_Q6_AHB_CLK             141
0150 #define GCC_WCSS_Q6_AXIM_CLK                142
0151 #define GCC_CDSP_CFG_AHB_CLK                143
0152 #define GCC_BIMC_CDSP_CLK               144
0153 #define GCC_CDSP_TBU_CLK                145
0154 #define GCC_CDSP_BIMC_CLK_SRC               146
0155 
0156 #define GCC_GENI_IR_BCR                 0
0157 #define GCC_USB_HS_BCR                  1
0158 #define GCC_USB2_HS_PHY_ONLY_BCR            2
0159 #define GCC_QUSB2_PHY_BCR               3
0160 #define GCC_USB_HS_PHY_CFG_AHB_BCR          4
0161 #define GCC_USB2A_PHY_BCR               5
0162 #define GCC_USB3_PHY_BCR                6
0163 #define GCC_USB_30_BCR                  7
0164 #define GCC_USB3PHY_PHY_BCR             8
0165 #define GCC_PCIE_0_BCR                  9
0166 #define GCC_PCIE_0_PHY_BCR              10
0167 #define GCC_PCIE_0_LINK_DOWN_BCR            11
0168 #define GCC_PCIEPHY_0_PHY_BCR               12
0169 #define GCC_EMAC_BCR                    13
0170 #define GCC_CDSP_RESTART                14
0171 #define GCC_PCIE_0_AXI_MASTER_STICKY_ARES       15
0172 #define GCC_PCIE_0_AHB_ARES             16
0173 #define GCC_PCIE_0_AXI_SLAVE_ARES           17
0174 #define GCC_PCIE_0_AXI_MASTER_ARES          18
0175 #define GCC_PCIE_0_CORE_STICKY_ARES         19
0176 #define GCC_PCIE_0_SLEEP_ARES               20
0177 #define GCC_PCIE_0_PIPE_ARES                21
0178 #define GCC_WDSP_RESTART                22
0179 
0180 #endif